Mitsubishi Electric MELSEC System Q Manual De Usuario página 71

Controladores lógicos programables
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Tabla de contenido
Señales E/S y memoria buffer
Dirección (Dez./Hex.)
Descripción
CH1
CH2
8425–8447
8681–8703
(20E9
(21E9
Reservado (no es posible el acceso)
H
H
20FF
)
21FF
)
H
H
8448
Reservado (no es posible el acceso)
(2100
)
H
8449 (2101
)
H
8450 (2102
)
H
8451 (2103
)
H
8452 (2104
)
Función de
H
rellamada
8453 (2105
)
H
8454 (2106
)
H
8455 (2107
)
H
8456 (2108
)
H
8457 (2109
)
H
8458 (210A
)
H
8704–8707
8960–8963
(2200
(2300
Reservado (no es posible el acceso)
H
H
2203
)
2303
)
H
H
Función de
8708
8964
monitor (obser-
(2204
)
(2304
)
vación de la
H
H
CPU del PLC)
Resultado de la función de monitor
8709
8965
0:
(2205
)
(2305
)
≠ 0: Se ha producido un error, el valor registrado en un
H
H
8710
8966
Número de las transmisiones de datos con la función de
(2206
)
(2306
)
monitor
H
H
Estado de las condiciones ajustadas
0:
1 – 10: Se ha cumplido la condición para el bloque
8711
8967
(2207
)
(2307
)
H
H
4096: La CPU del PLC está perturbada.
8712–8943
8968–
(2208
(2308
Reservado (no es posible el acceso)
H
H
22EF
)
23FF
)
H
H
Tab. 4-3:
Distribución de la memoria buffer de los módulos de interfaz (18)
*
Los valores sobre trasfondo gris pueden guardarse en la Flash-ROM del módulo de interfaz.
Sistema Q de MELSEC - Módulos de interfaz
Marco de datos para la 1a. conexión
de rellamada
Rangos de ajuste: 0BB8
0BD5
y 8001
H
Conexión de rellamada 2
Conexión de rellamada 3
Conexión de rellamada 4
Conexión de rellamada 5
Conexión de rellamada 6
Conexión de rellamada 7
Conexión de rellamada 8
Conexión de rellamada 9
Conexión de rellamada 10
Estado de la función de monitor
0: La función no se ejecuta
(Se espera a los ajustes para la
función de monitor.)
1: Espera al acceso a la CPU del
PLC
2: Acceso a la CPU del PLC
3: Se envían los datos de la CPU
del PLC.
Sin errores
código de error
No se ha cumplido ninguna condición
correspondiente (Se indica el número del blo
que cuya condición se ha cumplido en último
lugar.)
Ajuste previo*
hasta
H
hasta 801F
H
H
Memoria buffer
Protocolo válido
MC Libre Bidir
0
R/W
0
R
Referen-
cia
Secciones
20.4 y
20.6.3
Cap. 19
4 - 21

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