Mitsubishi Electric MELSEC System Q Manual De Usuario página 57

Controladores lógicos programables
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Tabla de contenido
Señales E/S y memoria buffer
Dirección (Dez./Hex.)
Descripción
CH1
CH2
147
307
(93
)
(133
)
H
H
Control de la
transmisión
148
308
(94
)
(134
)
H
H
149
309
(95
)
(135
)
H
H
Unidad de la longitud de datos
150
310
0: palabras
(96
)
(136
)
H
H
1: bytes
Sólo para RS232: Supervisión de la señal CD
151
311
0: se supervisa la señal CD
(97
)
(137
)
H
H
1: no se supervisa la señal CD
Sólo para RS232: Tipo de transmisión
152
312
0: dúplex completo
(98
)
(138
)
H
H
1: dúplex medio
153
313
(99
)
(139
)
H
H
Ajustes para
154
314
(9A
)
(13A
)
comunicación
H
H
dúplex medio
(sólo para
RS232)
155
315
(9B
)
(13B
)
H
H
Tab. 4-3:
Distribución de la memoria buffer de los módulos de interfaz (4)
*
Los valores sobre trasfondo gris pueden guardarse en la Flash-ROM del módulo de interfaz.
Los bits no aducidos en la tabla están reservados para el sistema y no pueden ponerse ni reponerse.
Sistema Q de MELSEC - Módulos de interfaz
b
Bit 0: Tipo del control de la
transmisión
0: Control DTR/DSR
1: Control código DC
b
Bit 8: Control DC1/DC3
0: ningún control
1: control activado
b
Bit 9: Control DC2/DC4
0: ningún control
1: control activado
Código para DC1/DC3
b
Bits 0 hasta 7: Código para DC1
(00
hasta FF
)
H
H
b
Bits 8 hasta 15: Código para DC3
(00
hasta FF
)
H
H
Código para DC2/DC4
b
Bits 0 hasta 7: Código para DC2
(00
hasta FF
)
H
H
b
Bits 8 hasta 15: Código para DC4
(00
hasta FF
)
H
H
Prioridad alta o baja de la transmi-
sión simultánea
0: Alta prioridad
Otros valores que 0: prioridad nega-
tiva (tiempo de espera de la transmi-
sión en unidades de 100-ms)
Comportamiento cuando se excede
el tiempo de repetición de envío
0: No repetir envío
1: Repetir envío
Validez de los datos con transmisión
simultánea
b
Bit 0: Datos recibidos
0: válido
1: inválido
b
Bit 8: Datos enviados
0: válido
1: inválido
Protocolo válido
Ajuste previo*
MC Libre Bidir
0 (DTR/DSR)
R/W
1311
H
1412
H
0 (palabras)
R/W
1 (sin supervi-
R/W
sión)
0 (dúplex com-
R/W
pleto)
0 (alta prioridad)
R/W
0 (sin repetición
de envío)
0
Memoria buffer
Referen-
cia
Cap. 11
Cap. 7
Cap. 8
Cap. 21
Sección
5.3.2
Cap. 21
Cap. 8
Cap. 12
Cap. 21
Sección
R/W
8.4
4 - 7

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