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EEPROM
Puesto que una EEPROM es un tipo de memoria, la mayoría de usuarios no lo considera un periférico.
Sin embargo, los contenidos de una EEPROM pueden modificarse con un programa y es una memoria no volátil,
que es eléctricamente borrable y es diferente de una RAM, ROM o EPROM. Varios miembros de la familia
MC68HC05 contienen una memoria EEPROM interna. Como se mencionó previamente, la EEPROM también
se puede agregar a un sistema como un periférico SPI externo.
Control de Periféricos
El control y el estado de la información para periféricos aparecen en la CPU como bits de datos en una
posición de memoria determinada. Usando este tipo de arreglo, los registros de control y de estado de los
periféricos, es conocido como mapa de memoria de E/S. Es una gran ventaja el tener los periféricos que
aparezcan como una posición de memoria. Cualquier instrucción de la CPU que puede operar en una posición de
memoria, se puede usar para controlar o verificar el estado de un periférico. Este tipo de arquitectura de E/S es
especialmente ventajoso con la familia MC68HC05 debido a las instrucciones de manipulación de bit de la CPU.
Este grupo de las instrucciones le da a un programador, la habilidad de poner a 1, a 0 individualmente o la
prueba del estado de cualquier bit en los registros de control de periféricos entre las direcciones $0000-$00FF.
Dependiendo del tipo y complejidad de un periférico, su control asociado y los registros de estado
pueden ocupar una o varias posiciones en el mapa de memoria del microcontrolador. Por ejemplo, un puerto de
E/S de propósito general ocupa dos posiciones de memoria en el mapa de memoria de un microcontrolador. Una
posición de byte, llamada registro de dirección de datos (DDR), se usa para controlar la función de cada pin de
E/S. La otra posición de byte, registro de datos del puerto, se usa para leer el estado de los pins de entrada o
imponer un nivel lógico 1 en un pin de salida. Un periférico complejo, como el temporizador en el
MC68HC705C8, ocupa 10 posiciones de byte, en el mapa de memoria de la MCU.
Mirando detalladamente el temporizador del MC68HC705J1A, se puede ver que este temporizador
multifunción de 15 etapas, es muy simple comparado con otros sistemas de temporizador, pero puede realizar
unas sofisticadas funciones de temporizador. Se describe un ejemplo completo, mostrando cómo este sistema
temporizador se puede usar para generar una exacta baja frecuencia de PWM.
Temporizador del MC68HC705J1A
En la
Figura 39
MC68HC705J1A. El temporizador consiste en tres secciones conectadas, cada una de estas secciones realiza
funciones de temporizador separadamente.
La cadena de temporización empieza con el reloj del bus interno del microcontrolador, el E-clock. El E-
clock viene de dividir la frecuencia del cristal por dos. A continuación el E-clock se divide por cuatro. A su vez,
la salida va a un contador de 8-bits. El valor de este contador, se puede leer por la CPU en cualquier momento en
la posición de memoria $09, en el registro del contador del temporizador (TCR). El valor del contador no puede
ser alterado por la CPU. Esto puede parecer como un temporizador simple; sin embargo, es útil en muchas
aplicaciones. Cuando el contador de 8-bits se desborda de $FF a $00, se pone a 1 el bit de estado del 'flag' de
desbordamiento del temporizador (TOF) del control del temporizador y del registro de estado (TCSR). El estado
de este 'flag' de estado, se puede probar en cualquier momento, por cualquiera de las diferentes instrucciones de
la CPU.
Opcionalmente, si la habilita la interrupción por desbordamiento del temporizador (TOIE), el bit de
control del temporizador y del registro de estado se pone a 1, el desbordamiento del contador de 8 bits, generará
una interrupción en la CPU. Por consiguiente, la función de desbordamiento del temporizador permite generar
una interrupción muy potente. El desbordamiento del temporizador se produce cada 1024 ciclos de E-clock
(primero dividido por cuatro seguido por un contador de 8-bits, divido por un 256).
se muestra un diagrama de bloques del temporizador multifunción de 15 etapas del
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