Direcciones Físicas Y Lógicas Del Buffer De Acceso Aleatorio - Mitsubishi Electric MELSEC System Q QJ71E71-100 Manual De Usuario

Controladores lógicos programables
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9 COMUNICACION USANDO EL BUFFER DE ACCESO ALEATORIO
9.3 Direcciones Físicas y Lógicas del Buffer de Acceso Aleatorio
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Esta sección explica la dirección principal del buffer de acceso aleatorio Ethernet (sin
respaldo de batería), el cual se designa con los comandos usados para la
comunicación de buffer de acceso aleatorio.
Las direcciones designadas del buffer de acceso aleatorio se muestran abajo.
Note que cuando designe la dirección principal del buffer de acceso aleatorio, la
dirección designada por un dispositivo externo es diferente desde que se designa con
las instrucciones TO/FROM (desde/a) en el programa de secuencia.
Dirección física
: Dirección designada con las instrucciones FROM/TO del
programa de secuencia
Dirección lógica
: Dirección designada por el dispositivo externo como el artículo de
dirección principal en el comando
Dirección física
680
( 1664)
H
267F
( 9855)
H
2680
( 9856)
H
a
3E7F
(15999)
H
Memoria buffer
Buffer fijado
Dirección lógica
Buffer de acceso
aleatorio
17FF
MELSEC-Q
0
( 0)
H
a
(6143)
H
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